一文详解SerDes：从电SerDes到光SerDes的技术演进

一文详解SerDes：从电SerDes到光SerDes的技术演进

SerDes（串行器/解串器）是现代高速数据传输系统中的关键技术，广泛应用于PCIe、USB、SATA等接口协议中。本文将为您详细介绍SerDes的工作原理、结构组成以及其在光通信领域的最新发展。

SerDes简介

SerDes（SERializer/Deserializer）是一种主流的高速时分多路复用（TDM）点对点串行通信技术，能够充分利用通信信道容量，提升通信速度，降低通信成本。目前，基于SerDes架构的商用通信协议最高可实现单通道56Gbps（甚至可达112Gbps）的速率，在未来高带宽、低成本的应用领域将越来越广泛。

SerDes的主要优点：

1. 减少布线冲突（非独立时钟嵌入在数据流中，解决了限制数据传输速率的Signal时钟的Jilter问题）
2. 带宽高
3. 引脚数目少
4. 抗噪声、抗干扰能力强（差分传输）
5. 降低开关噪声
6. 扩展能力强
7. 更低的功耗和封装成本

SerDes的分类：

1. 并行时钟SerDes：将并行宽总线串行化为多个差分信号对，传送与数据并联的时钟
2. 8B/10B编码SerDes（最常见的结构）：将每个数据字节映射到10bit代码，然后将其串行化为单一信号对
3. 嵌入式时钟SerDes：将数据总线和时钟串化为一个串行信号对
4. 位交错SerDes：将多个输入串行流中的位汇聚为更快的串行信号对

SerDes支持多种主流工业标准，包括Serial RapidIO、FiberChannel（FC）、PCI-Express（PCIe）、Advanced Switching Interface、Serial ATA（SATA）、1-Gb Ethernet、10-Gb Ethernet（XAUI）、Infiniband 1X、4X、12X等。

图1：简单的串行器/解串器Serdes的架构图（来源百度百科）

SerDes结构

SerDes收发器内部包括高速串并转换电路、时钟数据恢复电路、数据编解码电路、时钟纠正和通道绑定电路，为各种高速串行数据传输协议提供了物理层（PHY）基础。主流的8B/10B编码SerDes主要由物理介质相关子层（PMD）、物理媒介适配层（Physical Media Attachment，PMA）和物理编码子层（Physical Coding Sublayer，PCS）组成，且收发器的TX发送端和RX接收端功能独立。

各物理层的作用：

1. PCS层：负责数据流的编码/解码，是标准的可综合CMOS数字逻辑
2. PMA层：是数模混合CML/CMOS电路，负责串化/解串化
3. PMD层：负责串行信号通信

涉及模块：

1. TXPLL：使用具有1ps以下抖动的时钟为参考，输出数GHz级的时钟
2. RXCDR（时钟恢复）：复杂的控制回路，追踪传入数据的平均相位
3. TXdriver：将序列化模块转化为差分信号
4. RX均衡器：使用连续时间均衡器和DFE（判决反馈均衡器）来均衡高速效应

转化过程：

1. 发送（TX）即并转串：并行信号通过FiFO，传递给内部的8b/10b编码器、扰码器，防止数据连0/1，之后传递给串行器进行转化，经过均衡器均衡后，由驱动发出
2. 接收（RX）即串转并：输入的串行信号经过线性均衡器均衡后，去除高速时钟的jilter，CDR从数据中恢复Caputure时钟，并通过解串器转为对齐的并行信号，由驱动发出

光SerDes解串器

目前，电SerDes的高功耗和速度提升障碍是光互连发展的阻碍，人们逐渐把目光投向光SerDes的高速收发器。光SerDes解串器采用时间交错的多路复用技术来进行并行串行光信号的直接转换，同时电SerDes的缺失极大地降低了数据传输通道中的功耗。以一个工作在20个数据速率为2GHz的并行数字路径和1个40GHz串行光通道之间的光SerDes收发器为例，其功耗仅为13.5pJ/b左右，要远远低于同类型电SerDes的静态功耗。同时结合波分复用（WDM）、脉冲幅度调制（PAM）、正交相移键控（QPSK）等多种光复用技术，可进一步提高带宽。

在数据中心、超级计算机和光纤接入网的数据通信中，对未来带宽的需求不断增长，这促使传统的电子链路被光链路取代，用于片内和片外通信。虽然光学技术在带宽、损耗、串扰、电磁兼容等方面具有优势，但由于光信号不能直接由处理器处理，需要将光信号转换为电信号。传统的光互连通信解决方案是将并行电信号通过芯片内部的串行器/反串行器（SerDes）转换为高速串行电信号，再通过芯片外部的光收发器转换为光信号。由于SerDes电路的高功耗和链路比特率，光互连的发展逐渐面临瓶颈。收发器的大部分功率消耗在模拟电路，特别是SerDes上，而不是光学器件上。

以当前28Gb/s系统为例，收发器的光电转换（EO）和光电转换（OE）功耗仅为7.2pJ/b。但是整个链路的功率预算增长到29.5pJ/b，其中22.3pJ/b（75.6%）是由SerDes电路贡献的，这与OE-E转换没有直接关系。进一步的带宽扩展受到严重限制，因为需要均衡来恢复信号完整性，并在高速串行链路的末端重新计时，即使是非常短的几英寸距离。同时提高比特率和保持低功耗是不可持续的。因此，最好是提高并行度来提高链路比特率。但是并行化程度的提高是由芯片的引脚数决定的，而引脚数是由制造工艺、芯片尺寸、芯片顶层设计等决定的。

简单地说，光SerDes就是利用时分复用技术将并行电信号加载到光载波上，获得单波长单通道电平可能高于40Gb/s的串行光传输，同时完成光电和串并联转换。如图3所示，传统的电子SerDes收发器需要两级转换，以高速串行电信号为介质，将低速并行电信号转换为高速串行光信号，而光SerDes收发器实现了低速并行电信号与高速串行光信号的直接转换，即比传统的电SerDes多了一级光电信号转化。

图3：两种收发器的比较。a)在传统收发器中，以高速串行电信号为介质，利用电子SerDes将并行电信号转换为高速串行光信号。b)在所提出的收发器中，利用光SerDes将并行电信号直接转换为高速串行光信号。